Vengineerの戯言

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2021-07-08から1日間の記事一覧

XiangShan RISC-V : L1 plus Cache がある RISC-Vコア

@Vengineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった はじめに Twitter の TLで拾った下記の記事。 www.cnx-software.com L1 Instruction plus Cache がある 上記の記事の中にあったXiangShan open-source p…