Vengineerの戯言

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Xilinx Vivado SimulatorでCテストベンチを使う

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SystemVerilogの世界へようこそすべては、SystemC v0.9公開から始まった 

Adam Taylorさんのブログ、

www.adiuvoengineering.com

 

Windows版 + VHDL + C Testbench っぽい。

SystemVerilogでは、DPIがあるが、Vivadoは import はできるが、export は functionのみのサポート、export できないのが辛い。

この C Test Bench も同じようなもの?

 

Pythonバインディングもあるようですね。ここ

 

Vivadoちゃん、SystemVerilogの export task を早くサポートしてちょうだい。