Vengineerの妄想(準備期間)

人生は短いけど、長いです。人生を楽しみましょう!

2009-12-08から1日間の記事一覧

HLS : CyberWorkBench Forum 2009 の日経EDAOnlineの記事

Verification Engineerの戯言 CyberWorkBench Forum 2009の小島さんのレポートがアップされました。 「SystemCより壁が低いと感じた」,富士通QNETがNECの動作合成の評価結果を発表 「IPトランスポートFPGA開発へのCWB適用トライアル事例~ Cベースによる次…

SystemVerilog : AOP vs OOP

Verification Engineerの戯言 : SystemVerilogの世界へようこそ Enhancing System Verilog With AOP Conceptでは、 eのAOP(Aspect Oriented Programming)をSystemVerilogのOOP(Object Oriented Programming)で どのように表現すればいいかを説明してくれてい…