Vengineerの戯言

人生は短いけど、長いです。人生を楽しみましょう!

2011-08-15から1日間の記事一覧

IDesignSpec(IDS)を使えば、簡単!

Verification Engineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった VMM Centralのブログ、 Automatic generation of Register Model for VMM using IDesignSpecによると、 Agnisys Technology]のIDesignSpec(I…