Vengineerの妄想(準備期間)

人生は短いけど、長いです。人生を楽しみましょう!

2010-05-19から1日間の記事一覧

UVM : README

Verification Engineerの戯言 : SystemVerilogの世界へようこそ UVMのREADME Accellera Universal Verification Methodology version 1.0-EA (C) Copyright 2007-2009 Mentor Graphics Corporation (C) Copyright 2007-2009 Cadence Design Systems, Incorpo…

OVM => UVM変換ツール

Verification Engineerの戯言 : SystemVerilogの世界へようこそ bin/OVM_UVM_Rename.plにて、OVM => UVM変換が出来るようです。 このツールで変換の手間が大幅に省けるね! P.S ちなみにこのツールのCopyrightは、何と、Synopsys です! 検証、Verification…