Vengineerの妄想(準備期間)

人生は短いけど、長いです。人生を楽しみましょう!

2011-03-04から1日間の記事一覧

いろいろなCPU

Verification Engineerの戯言 : Twitter、Twitter新聞:Daily Vengineer's SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった CPUs in FPGAs: many faces to a trendは、Xilinx, Altera, Lattic, Actelで使えるCPUに関する情報満載の…

DvConバブルが終わって、静かになるだろうに?

Verification Engineerの戯言 : Twitter、Twitter新聞:Daily Vengineer's SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった DvConバブルが終わって、静かになるだろうに? って、ツイートしたら、@dennisbrophy さんに、Reply され…