2010-03-19から1日間の記事一覧
Verification Engineerの戯言 : SystemVerilogの世界へようこそ SystemC AMS – A New Proposal For Mixed-Signal Verificationは、先日発表されたSystemC-AMS関連の記事です。 これによると、CadenceのAMS Designerは、SystemC, Verilog-AMS, VHDL-AMS, Veri…
Verification Engineerの戯言 : SystemVerilogの世界へようこそ SystemC AMS – A New Proposal For Mixed-Signal Verificationは、先日発表されたSystemC-AMS関連の記事です。 これによると、CadenceのAMS Designerは、SystemC, Verilog-AMS, VHDL-AMS, Veri…