Vengineerの妄想(準備期間)

人生は短いけど、長いです。人生を楽しみましょう!

2011-01-11から1日間の記事一覧

UVM 1.0の特徴は、こんな感じ

Verification Engineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった 日経EDAOnlineのCadence,新世代EDA「Silicon Realization」の機能検証フローの概要を発表に掲載された UVM 1.0の特徴は、 引用 ・ Run sub-…

ModelSim Actel Editionは、6.6d

Verification Engineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった Actelの開発環境 Libero 9.1がリリースされました。 シミュレータは、ModelSim 6.6dのActel Editionです。ModelSim 6.6の一番新しい、6.6dで…

アルティマがGateRocketの日本代理店に!

Verification Engineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった EDA ExpressによるとFPGA検証ソリューションのGateRocketが日本上陸-アルティマと代理店契約のようです。 GateRocketは、FPGAデザインの検証…