2010-10-19から1日間の記事一覧
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Verification Engineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった ケイデンスとザイリンクスは、「ChipEstimate」内にXilinx IP Ecosystem micrositeとして「Xilinx IP Portal」を開設したようです。 FPGAもI…
Verification Engineerの戯言 : Twitter SystemVerilogの世界へようこそ、すべては、SystemC v0.9公開から始まった ModelSim XEが無くなるに対応して、Aldecがキャンペーンを始めました。 Active-HDL Designer Editionを50%オフでご提供！ Nodelock 1 Year T…
