Vengineerの妄想(準備期間)

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VCSでUVMとSystemC TLM2


VMM Centralのブログ、VCS Built-in TLI connectivity for UVM to SystemC TLM 2.0では、UVMとSystemC TLM 2をVCSのTLIで繋ぐ例を紹介しています。

VMMとSystemC TLM 2をTLIで接続する例も過去にアップされています。

MentorとCadenceは、SystemVerilogとSystemCの混在シミュレーションをNativeにできるのですが、
VCSってどうなんでしょうか?
TLIという機能がその働きをしているのでしょうか?

検証、Verification、Synopsys、UVM